Célula de Ensino evolução que gera resultados
Núcleo de Engenharia de Hardware, Arquitetura e Microeletrônica

Master Internacional em Engenharia de Hardware, Arquitetura de Processadores e Computação Avançada

O estudante consolidará maturidade técnica e liderança executiva para liderar projetos globais de desenvolvimento de chips, atuar em grandes fundições de semicondutores e conduzir pesquisas de ponta em arquitetura de computadores.

6 células 45h Master / Executivo
🚀 Escada de Valor • Pacotes & Credit Upgrade (R$ 29,99 a R$ 199,99)

Jornada Executiva: Engenharia de Hardware, Arquitetura de Computadores & Microeletrônica

Do curso base em Engenharia de Hardware (R$ 29,99) ao Master Internacional em Arquitetura de Processadores & RISC-V (R$ 199,99).

🎯 1. Porta de Entrada (R$ 29,99) Inicie pela Trilha Start (R$ 29,99) com baixo atrito financeiro e domine os fundamentos globais na prática.
💳 2. Abatimento no Upgrade (Credit Upgrade) 100% dos R$ 29,99 investidos na Trilha Start viram crédito imediato (cupom CHE29) para abater nas Trilhas 2, 3, 4 ou 5!
🌍 3. Certificação Dupla (PT-BR & EN) + ODS Certificados emitidos em Português e Inglês com competências alinhadas aos ODS da ONU para seu perfil global no LinkedIn.
Alinhamento ONU / Agenda Pós-2030: ODS 9 (Indústria, Inovação e Infraestrutura) ODS 4 (Educação Superior de Qualidade) ODS 8 (Trabalho Decente) ODS 17 (Parcerias Globais)
Nível 1 • 6h

Engenharia de Hardware de Computador: De C e Assembly à Microarquitetura e Multicore (Start)

Programação C de baixo nível, ponteiros e pilha, linguagem assembly e código de máquina, sistemas de E/S com interrupções e MMIO, design digital combinatório e sequencial, ULA e caminho de dados do processador, pipeline com tratamento de hazards, hierarquias de memória cache (I-cache/D-cache) e virtual, Lei de Amdahl e paralelismo multicore.

R$ 29,99 Gera R$ 29,99 em crédito de upgrade
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Engenharia de Hardware de Computador: De C e Assembly à Microarquitetura e Multicore (Start) R$ 44,90
Núcleo de Engenharia de Hardware, Arquitetura e Microeletrônica

Engenharia de Hardware de Computador: De C e Assembly à Microarquitetura e Multicore (Start)

Domínio essencial sobre como um computador funciona e é construído nos níveis de hardware e software: programação em C de baixo nível (ponteiros, pilha, funções) e linguagem assembly/código de máquina; subsistemas de entrada e saída (E/S), temporizadores e interrupções mapeadas em memória (MMIO); design lógico digital (álgebra booleana, portas lógicas, multiplexadores, decodificadores, somadores, redes combinatórias, flip-flops e registradores); microarquitetura de processadores (ULA, caminho de dados, unidade de controle e pipeline com tratamento de hazards); hierarquias de memória (cache de instruções/dados e memória virtual com TLB); e fundamentos de processadores paralelos, Lei de Amdahl e sistemas multicore.

📚 6 células ⏱️ 6h Iniciante
Engenharia de Hardware e Microeletrônica no Brasil: Projetos de SoCs, Lei de TICs e Indústria de Semicondutores R$ 59,90
Núcleo de Engenharia de Hardware, Arquitetura e Microeletrônica

Engenharia de Hardware e Microeletrônica no Brasil: Projetos de SoCs, Lei de TICs e Indústria de Semicondutores

O ecossistema brasileiro de semicondutores e hardware: marcos regulatórios e incentivos fiscais (Lei de TICs e Programa PADIS), polos de inovação em microeletrônica (Campinas, Porto Alegre, Santa Rita do Sapucaí e Recife), projeto de Sistemas em Chip (SoC) com barramentos industriais (AMBA AXI/AHB), encapsulamento e teste de circuitos integrados no país e desenvolvimento de placas de circuito impresso (PCB) com conformidade nacional.

📚 6 células ⏱️ 16h Intermediário
Design de Circuitos Digitais com Verilog/VHDL, Síntese em FPGAs e Simulação com ModelSim/EDA R$ 69,90
Núcleo de Engenharia de Hardware, Arquitetura e Microeletrônica

Design de Circuitos Digitais com Verilog/VHDL, Síntese em FPGAs e Simulação com ModelSim/EDA

Desenvolvimento e síntese de hardware digital com linguagens de descrição (HDLs): modelagem RTL com SystemVerilog e VHDL, projeto de Máquinas de Estados Finitos (FSM Mealy e Moore), arquitetura interna de FPGAs (LUTs, DSP slices, Block RAMs e PLLs), análise de temporização estática (Static Timing Analysis - STA, tempos de setup e hold, fechamento de timing), e criação de testbenches avançados com asserções (SVA) para validação formal em simuladores EDA.

📚 6 células ⏱️ 24h Intermediário / Avançado
Jornada da trilha

Células de aprendizagem

1

Célula 01: Computação Heterogênea e Aceleradores Especializados: GPUs, TPUs e NPUs para Inteligência Artificial

Arquitetura SIMD/SIMT em GPUs modernas, arrays sistólicos para multiplicação de matrizes em TPUs, computação em ponto flutuante de baixa precisão (FP16, BF16, INT8) e barramentos de altíssima velocidade (PCIe 5.0/6.0, CXL).

7h 30min
2

Célula 02: Arquiteturas de Memória para Supercomputação: NUMA, HBM e Coerência de Cache em Escala de Datacenter

Interconexões de processadores multiprocessados (UPI, Infinity Fabric), memórias High Bandwidth Memory (HBM3), protocolos de coerência baseados em diretório para centenas de cores e latência de memória.

7h 30min
3

Célula 03: Comunicação Técnica Internacional em Inglês para Engenheiros de Hardware (IEEE Standards)

Redação de especificações de arquitetura de hardware (Hardware Functional Specification - HFS), elaboração de datasheets de microchips, relatórios de errata e submissão de artigos no padrão IEEE/ACM.

7h 30min
4

Célula 04: Tendências de Fronteira: Computação Quântica, Processamento em Memória (PIM) e Chiplets 3D

O fim da escala de Dennard e os limites da Lei de Moore: empilhamento 3D de chips com micro-bumps e TSVs (Through-Silicon Vias), tecnologia de chiplets modulares e circuitos criogênicos de controle quântico.

7h 30min
5

Célula 05: Sustentabilidade em Semicondutores, Lixo Eletrônico (e-Waste) e Impacto dos ODS na Formação STEM

Pegada de carbono na manufatura de chips, eficiência energética computacional (Performance por Watt), reciclagem de materiais raros e o papel da engenharia de hardware na democratização tecnológica global.

7h 30min
6

Célula 06: Defesa Executiva do Projeto Master Capstone e Certificação Dupla Internacional

Apresentação final de projeto de processador ou arquitetura acelerada perante banca examinadora, com emissão do Certificado Master Internacional Bilíngue (PT/EN).

7h 30min